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實(shí)現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換:深入了解Achronix JESD204C解決方案
長期以來,Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應(yīng)用提供了創(chuàng)新性的FPGA產(chǎn)品和技術(shù),并幫助客戶不斷打破性能極限。其中一些應(yīng)用需要與先進(jìn)的模擬/數(shù)字轉(zhuǎn)換器(ADC)和數(shù)字/模擬轉(zhuǎn)換器(DAC)進(jìn)行對接——可由JESD204C完美地完成這項(xiàng)任務(wù)。
2023-12-27
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基于STEP FPGA的旋轉(zhuǎn)編碼器電路驅(qū)動
旋轉(zhuǎn)編碼器是用來測量轉(zhuǎn)速的裝置,因其人性化的操作被用于越來越多的電子設(shè)備中,旋轉(zhuǎn)編碼器有多種分類:以編碼器工作原理可分為:光電式、磁電式和觸點(diǎn)電刷式。以碼盤刻孔方式不同分為:增量式和絕對式兩類。
2023-11-29
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一種基于電流源基準(zhǔn)型LDO的放大器供電時(shí)序電路的應(yīng)用
相信你們在設(shè)計(jì)電路中經(jīng)常會碰到有時(shí)序要求的電路,比如說FPGA數(shù)字電路的供電,比如我們給模擬放大器的供電,等等。通常來說,我們有sequencers這種產(chǎn)品,其中又分為模擬時(shí)序控制芯片和數(shù)字時(shí)序控制芯片;模擬時(shí)序控制芯片,將電源輸出電壓作為輸入信號,實(shí)時(shí)監(jiān)測電源輸出,當(dāng)電源輸出達(dá)到閾值時(shí),會給一個類似于power good的電平信號,這樣可以將這個電平信號控制下一級電源的EN,從而控制下一級電源電路的開啟,從而達(dá)到時(shí)序控制的目的。
2023-11-10
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用FPGA構(gòu)建邊緣AI推理應(yīng)用很難?這樣做,變簡單!
對于希望在邊緣的推理處理器上實(shí)施人工智能 (AI) 算法的設(shè)計(jì)人員來說,他們正不斷面臨著降低功耗并縮短開發(fā)時(shí)間的壓力,即使在處理需求不斷增加的情況下也是如此?,F(xiàn)場可編程門陣列 (FPGA) 為實(shí)施邊緣AI所需的神經(jīng)網(wǎng)絡(luò) (NN) 推理引擎提供了特別有效的速度和效率效率組合。然而,對于不熟悉 FPGA 的開發(fā)人員來說,傳統(tǒng)FPGA的開發(fā)方法可能相當(dāng)復(fù)雜,往往導(dǎo)致他們?nèi)ミx擇不太理想的解決方案。
2023-11-02
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如何實(shí)現(xiàn)高效的供電網(wǎng)絡(luò) (PDN) 設(shè)計(jì)
在為 5G 應(yīng)用設(shè)計(jì)電源系統(tǒng)時(shí),設(shè)計(jì)人員必須考慮此類應(yīng)用固有的寬頻率范圍,從穩(wěn)壓器中的中頻到 FPGA內(nèi)核中的高時(shí)鐘頻率。這種端到端的全雙工設(shè)計(jì)對于優(yōu)化電源、電源轉(zhuǎn)換和配電過程的性能至關(guān)重要。
2023-10-30
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Microchip FPGA采用量身定制的PolarFire FPGA和SoC解決方案協(xié)議棧
為智能邊緣設(shè)計(jì)系統(tǒng)正面臨前所未有的困難。市場窗口在縮小,新設(shè)計(jì)的成本和風(fēng)險(xiǎn)在上升,溫度限制和可靠性成為雙重優(yōu)先事項(xiàng),而對全生命周期安全性的需求也在不斷增長。要滿足這些同時(shí)出現(xiàn)的需求,需要即時(shí)掌握特殊技術(shù)和垂直市場的專業(yè)知識。沒有時(shí)間從頭開始。Microchip Technology Inc.(美國微芯科技公司)今日宣布在其不斷增長的中端FPGA和片上系統(tǒng)(SoC)支持系列產(chǎn)品中增加了九個新的技術(shù)和特定應(yīng)用解決方案協(xié)議棧,涵蓋工業(yè)邊緣、智能嵌入式視覺和邊緣通信。
2023-10-11
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如何為Lattice CertusPro-NX FPGA評估板優(yōu)先考慮效率和成本
現(xiàn)代現(xiàn)場可編程門陣列(FPGA)系列(如Lattice Semiconductor CertusPro?-NX)適用面廣泛,但需滿足根據(jù)特定市場驅(qū)動的需求而定制的電源要求。如果不清楚該如何平衡成本、性能和尺寸這三個要素,則可能難以為這些器件選擇合適的供電方式。本文介紹了適用于CertusPro-NX評估板的解決方案,同時(shí)針對特定需求闡明了各種解決方案實(shí)現(xiàn)優(yōu)化的原理和原因。μModule?電源解決方案尺寸小巧、設(shè)計(jì)簡單,為FPGA系統(tǒng)提供了一種非常實(shí)用的設(shè)計(jì)方法,但還有其他選項(xiàng)可供電源系統(tǒng)架構(gòu)師考慮。
2023-09-28
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搭建硬實(shí)時(shí)系統(tǒng)太難了?用它試一下!
現(xiàn)場可編程門陣列 (FPGA)、支持 Linux 的RISC-V 微控制器單元 (MCU) 子系統(tǒng)、先進(jìn)的存儲器架構(gòu)和高性能通信接口,是設(shè)計(jì)人員的重要工具。對于安全互聯(lián)系統(tǒng)、安全關(guān)鍵型系統(tǒng),以及人工智能 (AI) 和機(jī)器學(xué)習(xí) (ML) 等各種硬實(shí)時(shí)確定性系統(tǒng)的設(shè)計(jì)人員,更是如此。
2023-09-25
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通信 工業(yè)和嵌入式光通信技術(shù)進(jìn)步背后的推動力
隨著工業(yè)和嵌入式計(jì)算對通信距離、低功耗和小型配置需求的提高,對通信帶寬也提出了更高的要求。而FPGA等特定使能技術(shù)以及收發(fā)器、連接器和接收器的進(jìn)步也為光通信技術(shù)的快速發(fā)展提供了支持。
2023-09-20
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使用FPGA實(shí)現(xiàn)自適應(yīng)全陣列局部調(diào)光解決方案
乍一看,今天的汽車看起來跟幾十年前的汽車沒什么差別,但事實(shí)并非如此。車艙內(nèi)、引擎蓋下甚至輪胎內(nèi)都隱藏這巨大的變化,可謂到處都有進(jìn)步。
2023-08-21
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卷積神經(jīng)網(wǎng)絡(luò)的硬件轉(zhuǎn)換:什么是機(jī)器學(xué)習(xí)?——第三部分
AI應(yīng)用通常需要消耗大量能源,并以服務(wù)器農(nóng)場或昂貴的現(xiàn)場可編程門陣列(FPGA)為載體。AI應(yīng)用的挑戰(zhàn)在于提高計(jì)算能力的同時(shí)保持較低的功耗和成本。當(dāng)前,強(qiáng)大的智能邊緣計(jì)算正在使AI應(yīng)用發(fā)生巨大轉(zhuǎn)變。與傳統(tǒng)的基于固件的AI計(jì)算相比,以基于硬件的卷積神經(jīng)網(wǎng)絡(luò)加速器為載體的智能邊緣AI計(jì)算具備驚人的速度和強(qiáng)大的算力,開創(chuàng)了計(jì)算性能的新時(shí)代。
2023-06-14
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用于多時(shí)鐘域 SoC 和 FPGA 的同步器技術(shù)
通常,傳統(tǒng)的雙觸發(fā)器同步器用于同步單比特電平信號。如圖1和圖2所示,觸發(fā)器A和B1工作在異步時(shí)鐘域。CLK_B 時(shí)鐘域中的觸發(fā)器 B1 對輸入 B1-d 進(jìn)行采樣時(shí),輸出 B1-q 有可能進(jìn)入亞穩(wěn)態(tài)。但在 CLK_B 時(shí)鐘的一個時(shí)鐘周期期間,輸出 B1-q 可能穩(wěn)定到某個穩(wěn)定值。
2023-05-23
- 意法半導(dǎo)體推出Page EEPROM二合一存儲器,提升智能邊緣設(shè)備的性能和能效
- 利用電容測試方法開創(chuàng)鍵合線檢測新天地
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